 Synopsys Prime Time靜態(tài)時序分析與ModelSim高級仿真培訓 |
| 培養(yǎng)對象 |
1.理工科背景，有志于數(shù)字集成電路設計工作的學生和轉(zhuǎn)行人員；
2.需要充電，提升技術水平和熟悉設計流程的在職人員；
3.集成電路設計企業(yè)的員工內(nèi)訓。
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| 入學要求 |
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學員學習本課程應具備下列基礎知識：
◆電路系統(tǒng)的基本概念。 |
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班級規(guī)模及環(huán)境--熱線:4008699035 手機:15921673576( 微信同號) |
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堅持小班授課，為保證培訓效果，增加互動環(huán)節(jié)，每期人數(shù)限3到5人。 |
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上課時間和地點 |
上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】：北京中山學院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學/六宅臻品 【鄭州分部】：鄭州大學/錦華大廈 【石家莊分部】：河北科技大學/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
最近開課時間(周末班/連續(xù)班/晚班）： Synopsys Prime Time：2025年11月17日..合作共贏....實用實戰(zhàn)....實戰(zhàn)培訓....用心服務..........--即將開課--...................... |
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實驗設備 |
☆資深工程師授課
☆注重質(zhì)量
☆邊講邊練
☆合格學員免費推薦工作
☆合格學員免費頒發(fā)相關工程師等資格證書，提升您的職業(yè)資質(zhì)
專注高端培訓15年，端海提供的證書得到本行業(yè)的廣泛認可，學員的能力
得到大家的認同，受到用人單位的廣泛贊譽。
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最新優(yōu)惠 |
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◆在讀學生憑學生證，可優(yōu)惠500元。 |
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質(zhì)量保障 |
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1、培訓過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓班中重聽；
2、課程完成后,授課老師留給學員手機和Email,保障培訓效果,免費提供半年的技術支持。
3、培訓合格學員可享受免費推薦就業(yè)機會。 |
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Synopsys Prime Time靜態(tài)時序分析與ModelSim高級仿真培訓 |
第一階段 |
Synopsys Prime Time靜態(tài)時序分析? |
為了幫助工程師進一步全面系統(tǒng)地理解Prime Time的概念與方法，學習并掌握Synopsys公司的靜態(tài)時序分析工具，國家集成電路設計西安產(chǎn)業(yè)化基地EDA培訓中心將于近日舉辦Prime Time培訓。靜態(tài)時序分析技術是一種窮盡分析方法，用以衡量電路性能。在功能和性能上滿足全片分析的目的，支持片上系統(tǒng)設計，即它為很快滿足設計時序要求取得了突破，能提供百萬門級設計所要求的性能，并在一個合理的時間內(nèi)分析設計，而且它帶有先進的時序分析技術和可視化的特性，用于全芯片驗證。
●? 主要內(nèi)容：
1. 闡述了靜態(tài)時序分析的三個步驟，四個類型的時序路徑及各路徑之間的約束。
2. 討論了用于計算時鐘網(wǎng)絡延遲、外部時鐘延遲、驗證設計的最小時鐘脈沖寬度、對門控時鐘進行檢查及在已有時鐘的基礎上定義一個新的時鐘命令。
3. 明確了例外時間（Timing Exceptions）的定義，討論了例外時間的范圍，給出了多路徑及其規(guī)范，提供了多路徑的約束。
4. 高效的靜態(tài)時序分析方式，包括瓶頸、多事件及同時發(fā)生的事件最大、最小值分析等。 5. 闡述了為任何設計目標列表應用程序?qū)傩缘拿�，用于從一個設計對象上找到其屬性的兩種命令，允許創(chuàng)建自己的Prime Time命令。
6. 定義了時間模式、討論了在靜態(tài)時序分析中用時間模式的益處、Prime Time支持的三種時間模式及用時間模式修改link_path變量。
7．闡述了物理時間被應用在頂層綜合時的原因、SDF的定義及在Prime Time中認可的三種寄生模式。
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第二階段 |
ModelSim高級調(diào)試功能做HDL仿真? |
為了幫助工程師進一步全面系統(tǒng)地理解ModelSim仿真的概念與方法，學習并掌握Mentor公司的相關仿真工具，國家集成電路設計西安產(chǎn)業(yè)化基地EDA培訓中心將于近日舉辦Mentor ModelSim培訓。
?ModelSim是業(yè)界最優(yōu)秀的HDL語言仿真器之一，它提供最友好的調(diào)試環(huán)境，支持PC和UNIX平臺，是唯一的單一內(nèi)核支持VHDL和Verilog混合仿真的仿真器。ModelSim是作FPGA、ASIC設計的RTL級和門級電路仿真的首選，在業(yè)界一直保持在VHDL和VHDL/Verilog混合語言功能仿真器市場占有率第一的位置，在Verilog市場也有相當高的市場占有率。
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本課程讓學員們首先熟悉ModelSim基本概念，并且進一步學習ModelSim的高級調(diào)試概念和技巧，充分和有效地發(fā)揮ModelSim的各項功能，分析和調(diào)試數(shù)字電路設計。通過運用各種方法和調(diào)試手段，學習如何產(chǎn)生高性能的仿真模型，得到更可靠的設計結(jié)果。您將面對一個真實的富有挑戰(zhàn)的設計，在高質(zhì)量的測試平臺上用測試矢量去仿真和分析它，并用系統(tǒng)的方法去解決問題。
● 在這次課程中可以學到：
◎ ModelSim的基本概念和流程；
◎ 高級的調(diào)試概念和方法；
◎ 運用Debug Detective;
◎ 產(chǎn)生和比較多個數(shù)據(jù)庫；
◎ 運用“虛擬對象”去調(diào)試設計；
◎ 用Tcl/Tk控制設計和ModelSim環(huán)境；
◎ 調(diào)試多種類型的設計錯誤；
◎ 測定設計的“代碼覆蓋率”；
◎ 用“Signal Spy”實現(xiàn)高級探查；
◎ 應用先進的波形比較功能；
◎ 分析和提高設計及最終產(chǎn)品的性能，從抽象描述到門級實現(xiàn)；
● 適合的聽眾：
??◎ 在系統(tǒng)設計、硬件設計或軟件設計中將用到VHDL、Verilog或VHDL/Verilog 混合HDL語言進行仿真和分析的工程師；
??● 需要的知識：
◎ VHDL或Verilog硬件描述語言；
◎ HDL語言功能仿真的基本概念 |
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